數位電路,化簡邏輯函式

2021-04-28 02:29:09 字數 1223 閱讀 8810

1樓:爺爺泡的方便麵

①解 a異或b可以表示成:ab非+a非b ,用這樣的形式去掉原式中的「異或」「同或」。再根據摩根定律和邏輯代數的方法一般就可以化簡成 最簡與或式。

如果遇到原式十分複雜的情況,可以用「卡諾圖」來化簡,其步驟一般是:

(1)將邏輯函式寫成最小項表示式

(2)按最小項表示式填卡諾圖,式中包含了的最小項其相應位置填1,其餘填0

(3)合併最小項,將相鄰的「1」圈成一組,每組含2^n個方格,每個包圍圈對應一個新的乘積項(即一個最簡與或項)。

(4)將所有包圍圈對應的乘積項相加。得到最簡與或表示式。

②解幾進位制的計數器就是看該計數器計數計了多少個數然後返回初值。比如一個計數器從1開始計數,計到11的時候其下一個狀態又變成1了,那麼就是一個11進位制的計數器。

③不好意思,這個我不確定哈,我估計是為了匹配邏輯閘的輸出電平。可以看成是一個上拉電阻。

④解首先,邏輯電路的每個狀態對應一個圈,圈內的數字是來表示該狀態。圈之間一般有箭頭,箭頭表示狀態的轉換,即從一個狀態轉換到另一個狀態。箭頭上面的數字表示狀態轉換需要的條件。

具體表示的是那個量,還要根據畫出狀態圖的狀態表。表頭上肯定會寫出的。

最後題,解

cp表示clock pulse 是工作時鐘,圖示的jk觸發器根據jk觸發器的邏輯表示式,當j=k=1時,輸出的下一個狀態 = 目前狀態 取非。即qn+1=qn非。

另:圖中哪有a,b啊?

參考資料:電子技術基礎(數字部分) 高教

希望我的回答對你有幫助哈~ ^_^

2樓:所珈藍寶

①解 a異或b表示:ab非+a非b 用形式掉原式異或同或再根據摩根定律邏輯代數般化簡 簡與或式

遇原式十複雜情況用卡諾圖化簡其步驟般:

(1)邏輯函式寫項表示式

(2)按項表示式填卡諾圖式包含項其相應位置填1其餘填0

(3)合併項相鄰1圈組每組含2^n格每包圍圈應新乘積項(即簡與或項)

(4)所包圍圈應乘積項相加簡與或表示式

②解幾進位制計數器看該計數器計數計少數返初值比計數器1始計數計11候其狀態變111進位制計數器

③意思我確定哈我估計匹配邏輯閘輸電平看拉電阻

題解cp表示clock pulse 工作鍾圖示jk觸發器根據jk觸發器邏輯表示式j=k=1輸狀態 = 目前狀態 取非即qn+1=qn非

另:圖哪ab啊

參考資料:電技術基礎(數字部) 高教

希望我答幫助哈~ ^_^

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