1樓：匿名使用者
行為描述bai
方式：module dff1(clk,in,out);
input clk;
input in;
output reg out;
always @(posedge clk)out <= in;
end module
至於du
結構描述方式，d觸發器已
zhi經是時序邏輯電dao路的最小
回單元，沒有必要
答什麼結構描述方式。
採用 verilog hdl語言設計一個非同步清零，非同步置位d觸發器(需要分頻器，50hz分頻) 20
2樓：
module d(rst1,rst0,clk,in,out);
input rst1,rst0,clk,in;
output out;
reg out;
always@(posedge clk or negedge rst1 or negedge rst0)
begin
if(~rst1) out<=1; //注意下降du沿配套
zhi的條件寫
dao法
else if(~rst0) out<=0; //注意下降沿配套的條件寫法
else out <= in; //直接完成d觸發專器的特性方程就可以了
屬//begin
//if(in) out<=in;
//else out<=out;
//end
endendmodule
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